verilog 怎么将等号右边的表达式中的某几位赋给左边?
来源:学生作业帮 编辑:搜搜做题作业网作业帮 分类:数学作业 时间:2024/07/04 20:53:39
verilog 怎么将等号右边的表达式中的某几位赋给左边?
input [10:0] hcount,vcount;
output [10:0] rd_addr;
wire [10:0] temp;
assign temp = hcount - 11'd207;
assign rd_addr = temp[10:1];
最后两行如何用一句话搞定?不要用>>1
input [10:0] hcount,vcount;
output [10:0] rd_addr;
wire [10:0] temp;
assign temp = hcount - 11'd207;
assign rd_addr = temp[10:1];
最后两行如何用一句话搞定?不要用>>1
![verilog 怎么将等号右边的表达式中的某几位赋给左边?](/uploads/image/z/18192883-67-3.jpg?t=verilog+%E6%80%8E%E4%B9%88%E5%B0%86%E7%AD%89%E5%8F%B7%E5%8F%B3%E8%BE%B9%E7%9A%84%E8%A1%A8%E8%BE%BE%E5%BC%8F%E4%B8%AD%E7%9A%84%E6%9F%90%E5%87%A0%E4%BD%8D%E8%B5%8B%E7%BB%99%E5%B7%A6%E8%BE%B9%3F)
拼接语句试一下.assign rd_addr ={0,(hcount - 11'd207)};
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