搜搜做题作业网触发器的状态在下列图中,设触发器的初态为0,能实现Q(n+1)的电路为： 下图中的26题,不太懂的是为什么那个
来源：学生作业帮 编辑：搜搜做题作业网作业帮 分类：物理作业 时间：2024/07/23 03:25:44
触发器的状态
在下列图中,设触发器的初态为0,能实现Q(n+1)的电路为：
下图中的26题,不太懂的是为什么那个波形 A、B、F的上升或下降的波形不对称对齐呢?
试用与非门设计一个半加器.令A、B分别为被加数、加数、S、C分别为和、进位.要求：
(1)列出真值表
(2)写出逻辑表达式
(3)画出逻辑电路图
下图是逻辑电路图看的不太懂噢、
(1) D 触发器简单,Qn+1 = D,图（D）的 D = 0 ,图 (B) 的 D = Q = 0 ,都是错的.
JK 触发器是：
J=1,K=0时,Qn+1=1；
J=0,K=1时,Qn+1=0；
J=K=0时,Qn+1=Qn；
J=K=1时,Qn+1= - Qn；
图(A) 是错的,图 C 是对的,满足：J=1,K=0时,Qn+1=1.
(2) 分析数字电路的波形图,就是分析输出状态少的时间段,找出输入与输出的关系：
图中 F = 0（L） 时,A = B = 1（H）,即 F = (AB)',是 2 输入端与非门.
(3) 逻辑图只用与非门构建,就要把表达式转换成“与” 的关系：
S =A'B + AB' = （A * B' * A' * B）' ；（AB）' = A' + B' ,先把 A'B、AB' 看成一个整体.
再问： (1)刚开始看不出来j k的输入是多少，现在看出来了。(2)不太懂的是为什么那个波形 A、B、F的上升或下降的波形不对称对齐呢？下面这个图我就能看懂，因为Q0、Q1、Q2、C在cp的上升或者下降沿所对应的图形都是对齐的，而上面那个图的波形却不是上下对齐的、
(3)A输入的那个 与非门 不是输入一个A吗？怎么跟触发器有两个输入，难道是A&A？
再答： （3）的第一级只是把A 、B 的信号取反，得到需要的A'、B' ，把两个输入端合并作为非门用。 触发器是时序电路，输出变化只能发生在时钟有效时刻，所以波形整齐，而（2）是组合逻辑，输出状态随时反应输入状态的变化。
JK 触发器是：
J=1,K=0时,Qn+1=1；
J=0,K=1时,Qn+1=0；
J=K=0时,Qn+1=Qn；
J=K=1时,Qn+1= - Qn；
图(A) 是错的,图 C 是对的,满足：J=1,K=0时,Qn+1=1.
(2) 分析数字电路的波形图,就是分析输出状态少的时间段,找出输入与输出的关系：
图中 F = 0（L） 时,A = B = 1（H）,即 F = (AB)',是 2 输入端与非门.
(3) 逻辑图只用与非门构建,就要把表达式转换成“与” 的关系：
S =A'B + AB' = （A * B' * A' * B）' ；（AB）' = A' + B' ,先把 A'B、AB' 看成一个整体.
再问： (1)刚开始看不出来j k的输入是多少，现在看出来了。(2)不太懂的是为什么那个波形 A、B、F的上升或下降的波形不对称对齐呢？下面这个图我就能看懂，因为Q0、Q1、Q2、C在cp的上升或者下降沿所对应的图形都是对齐的，而上面那个图的波形却不是上下对齐的、
(3)A输入的那个 与非门 不是输入一个A吗？怎么跟触发器有两个输入，难道是A&A？再答： （3）的第一级只是把A 、B 的信号取反，得到需要的A'、B' ，把两个输入端合并作为非门用。 触发器是时序电路，输出变化只能发生在时钟有效时刻，所以波形整齐，而（2）是组合逻辑，输出状态随时反应输入状态的变化。
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